旧工控板的时序、译码、握手和保护逻辑常被集中在 CPLD 中。本文围绕 AMD/Xilinx XC95144XL-10TQG100C 给出 BOM 配单思路：先锁定 144 宏单元、TQG100 封装和 JTAG 在系统编程条件，再把 3.3V 电源、I/O 电平、原始逻辑文件和产测方式一起写入询盘。
结论：旧工控板需要恢复或改版时，XC95144XL-10TQG100C 不能只作为一颗“可编程逻辑芯片”单独采购。它属于 3.3V XC9500XL CPLD 路线，XC95144XL 具有 144 个宏单元，TQG100 对应特定封装与 I/O 资源，并支持 JTAG 在系统编程。要把板卡真正做成可交付 BOM，必须同时锁定完整料号、原始逻辑文件、JTAG 下载与测试、3.3V 电源、I/O 电平及关键时序关系。
| BOM 模块 | 与 XC95144XL-10TQG100C 的关系 | 询价或改版时必须明确的内容 |
|---|---|---|
| 逻辑核心 | XC95144XL 为 144 宏单元的 XC9500XL CPLD | 完整料号、原板顶标、目标逻辑密度、时序约束和是否保留原有引脚分配 |
| 封装与装配 | TQG100 对应特定封装和 I/O 资源 | PCB 封装库、BGA/QFP 焊盘版本、钢网与返修条件；不要只按“100 脚”理解 |
| 编程与测试 | 支持 IEEE 1149.1 JTAG 与在系统编程 | JTAG 接口、测试点、下载工具、JEDEC/工程文件、产测步骤和板卡版本 |
| 电源与去耦 | XC9500XL 为 3.3V CPLD 路线 | 3.3V 供电能力、去耦位置、上电过程、地划分以及与外围器件的电源关系 |
| I/O 与时序 | CPLD 负责板内逻辑、译码、握手或时序整理 | 输入输出电平、时钟、复位、负载、上电默认状态、外部连接器和关键波形 |
对于旧板，最危险的误区是“芯片型号对上了，BOM 就完成了”。如果没有原始 JEDEC 文件、JTAG 接口或关键 I/O 时序，装上正确的芯片也可能无法恢复原有功能。把可编程逻辑视为一段软硬件结合的模块，才能让采购、维修和工程验证形成同一条路径。
维修类项目的目标通常是让现有设备尽快恢复。优先收集原板完整丝印、CPLD 顶标、PCB 版本、可读取的 JEDEC 文件、JTAG 接口位置和已知故障现象。若逻辑文件完好，重点是确保目标料号、封装和下载流程与原板一致；若逻辑文件缺失，则应把逻辑恢复、接口抓波和功能回归作为单独工程工作。
给旧板增加一个状态输入、修改互锁顺序或调整握手逻辑时，最容易低估的不是逻辑表达式，而是现有引脚约束和时序边界。建议先冻结外部连接器、关键时钟、复位和输出负载，再评估是否有足够的逻辑与 I/O 余量。这样可以避免因为局部功能变更破坏原有产测或现场接口。
当项目进入持续生产，BOM 不能停留在“买到芯片”。需要明确来料标签、包装方式、下载文件版本、JTAG 治具、功能测试向量、生产板号和异常追溯方式。这样即使主芯片现货、代工和装配在不同环节进行，最终板卡也能按同一逻辑版本交付。
如需围绕 XC95144XL-10TQG100C 做备料、维修或改版，请提供原板正反面照片、完整顶标、PCB 版本、逻辑/JEDEC 文件、JTAG 接口信息、关键 I/O 表、供电与时钟条件、目标数量和交期。若要修改功能，再补充时序图、故障现象或新增接口要求。这样可以把主芯片、编程、装配和测试一起组成可执行的工控 CPLD BOM。
不能默认直接替换。逻辑资源、封装、引脚分配、I/O 电平、工程文件、下载工具和板级时序都可能不同，应按整板改版任务处理。
XC9500XL 支持 JTAG 在系统编程与边界扫描。保留接口、测试点和下载文件，能让样机调试、维修和量产测试更可控。
可以先按完整顶标、封装照片、数量和交期做现货与装配条件的准备；但恢复原功能仍需要获得或重建逻辑文件，并安排板级验证。
原板正反面照片、PCB 版本、JEDEC/工程文件、JTAG 接口位置、关键 I/O 与时序表、供电和时钟信息，能显著缩短配单和工程判断时间。
不能默认直接替换。逻辑资源、封装、引脚分配、I/O 电平、工程文件、下载工具和板级时序都可能不同，应按整板改版任务处理。
XC9500XL 支持 JTAG 在系统编程与边界扫描。保留接口、测试点和下载文件，能让样机调试、维修和量产测试更可控。
可以先按完整顶标、封装照片、数量和交期做现货与装配条件的准备；但恢复原功能仍需要获得或重建逻辑文件，并安排板级验证。
原板正反面照片、PCB 版本、JEDEC/工程文件、JTAG 接口位置、关键 I/O 与时序表、供电和时钟信息，能显著缩短配单和工程判断时间。
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